Dell OpenManage Server Administrator Guide de l'interface de ligne de commande, version 7.3

Capacités et propriétés de cache d'un processeur particulier

Pour afficher les propriétés de cache d'un processeur installé sur un connecteur donné, entrez :

omreport chassis processors index=n

omreport mainsystem processors index=n

Le paramètre index est facultatif. Si vous ne définissez pas d'index, Server Administrator affiche les propriétés de tous les processeurs. Si vous définissez l'index, Server Administrator affiche les propriétés d'un processeur donné.

Le tableau suivant répertorie les champs définis pour les fonction présentes dans un microprocesseur :

Tableau 1. Microprocesseurs et champs
Microprocesseur	Champs
Processeur Intel	Prend en charge 64 bits Hyperthreading (HT) Technologie de virtualisation (VT) Demand Based Switching (DBS) Execute Disable (XD) (Désactiver l'exécution) Mode Turbo
Processeur AMD	Prend en charge 64 bits AMD-V AMD PowerNow! Non Exécutable (NX)

Les champs suivants sont définis pour un cache présent dans un microprocesseur. Si le cache est interne au processeur, les champs n'apparaissent pas dans le rapport de cache :

Vitesse
Type de dispositif de cache pris en charge
Type de dispositif de cache présent
Nom du logement externe

REMARQUE : En raison de restrictions liées à certains systèmes d'exploitation (par exemple, VMware ESXi), certaines fonctionnalités ne sont pas disponibles dans cette version d'OpenManage Server Administrator.

Le tableau suivant répertorie les champs affichés pour chaque cache d'un processeur :

Tableau 2. Champs et description
Champ	Description
Status (Condition)	Indique si un cache particulier du processeur est activé ou désactivé.
Niveau	Fait référence à un cache principal ou secondaire. Un cache principal est un banc de mémoire intégré au processeur. Un cache secondaire est une zone intermédiaire qui alimente le cache principal. Un cache secondaire est intégré au processeur ou réside dans un jeux de puces de mémoire en dehors du processeur. Le cache de processeur interne est un cache de niveau 1 (ou L1). Le cache L2 est le cache externe dans un système doté d'un processeur Intel Pentium, et il s'agit du second niveau de cache accessible. Les termes L1 et L2 n'indiquent pas l'emplacement physique du cache (interne ou externe), mais spécifient le premier cache accessible (L1, et donc interne).
Vitesse	Se rapporte au débit auquel le cache peut transférer des données de la mémoire principale au processeur.
Taille maximale	Quantité maximale de mémoire d'un cache en kilo-octets.
Taille installée	Taille réelle du cache.
Type	Indique si le cache est principal ou secondaire.
Emplacement	Correspond à l'emplacement du cache sur le processeur ou sur une puce en dehors du processeur.
Règles d'écriture	Dans une règle d'écriture différée, la cache fait office de mémoire tampon. Lorsque le processeur démarre un cycle d'écriture, le cache reçoit les données er arrête le cycle. Le cache écrit ensuite les données dans la mémoire principale lorsque le bus du système est disponible. Dans une règle d'écriture intermédiaire, le processeur écrit via le cache dans la mémoire principale. Le cycle d'écriture ne se termine pas tant que les données ne sont pas stockées dans la mémoire principale.
Associativité	Associativity (associativité) se rapporte à la façon dont le contenu de la mémoire principale est stocké sur le cache. Un cache à pleine associativité permet de stocker n'importe quelle ligne de la mémoire principale dans n'importe quel emplacement du cache. Un cache associatif n-voies associe directement n lignes de mémoire aux mêmes n lignes du cache. Par exemple, la ligne 0 d'une page en mémoire est stockée dans la ligne 0 de la mémoire cache.
Type de dispositif de cache pris en charge	Type de mémoire à accès aléatoire (SRAM) que peut prendre en charge le périphérique.
Type de dispositif de cache présent	Type de mémoire SRAM installée prise en charge par le cache.
Nom imprimé à côté du socket externe	Nom imprimé sur la carte système à côté du socket.
Type de correction d'erreur	Identifie le type de vérification et de correction d'erreur (ECC) qu'exécute la mémoire ECC, par exemple ECC à correction d'erreur et ECC sans correction d'erreur.

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